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diff --git a/src/soc/intel/alderlake/include/soc/gpio.h b/src/soc/intel/alderlake/include/soc/gpio.h index 407c3b757f..14338e9024 100644 --- a/src/soc/intel/alderlake/include/soc/gpio.h +++ b/src/soc/intel/alderlake/include/soc/gpio.h @@ -3,17 +3,22 @@ #ifndef _SOC_ALDERLAKE_GPIO_H_ #define _SOC_ALDERLAKE_GPIO_H_ +#if CONFIG(SOC_INTEL_ALDERLAKE_PCH_S) +#include <soc/gpio_defs_pch_s.h> +#define CROS_GPIO_NAME "INTC1056" +#define CROS_GPIO_DEVICE_NAME "INTC1056:00" +#elif CONFIG(SOC_INTEL_ALDERLAKE_PCH_N) #include <soc/gpio_defs.h> -#include <intelblocks/gpio.h> - -#if CONFIG(SOC_INTEL_ALDERLAKE_PCH_N) #define CROS_GPIO_NAME "INTC1057" #define CROS_GPIO_DEVICE_NAME "INTC1057:00" #else +#include <soc/gpio_defs.h> #define CROS_GPIO_NAME "INTC1055" #define CROS_GPIO_DEVICE_NAME "INTC1055:00" #endif +#include <intelblocks/gpio.h> + /* Enable GPIO community power management configuration */ #define MISCCFG_GPIO_PM_CONFIG_BITS (MISCCFG_GPVNNREQEN | \ MISCCFG_GPPGCBDPCGEN | MISCCFG_GPSIDEDPCGEN | \ diff --git a/src/soc/intel/alderlake/include/soc/gpio_defs_pch_s.h b/src/soc/intel/alderlake/include/soc/gpio_defs_pch_s.h new file mode 100644 index 0000000000..a2ab413267 --- /dev/null +++ b/src/soc/intel/alderlake/include/soc/gpio_defs_pch_s.h @@ -0,0 +1,330 @@ +/* SPDX-License-Identifier: GPL-2.0-only */ + +#ifndef _SOC_ALDERLAKE_GPIO_DEFS_PCH_S_H_ +#define _SOC_ALDERLAKE_GPIO_DEFS_PCH_S_H_ + +#ifndef __ACPI__ +#include <stddef.h> +#endif +#include <soc/gpio_soc_defs_pch_s.h> + +#define GPIO_NUM_PAD_CFG_REGS 4 /* DW0, DW1, DW2, DW3 */ + +#define NUM_GPIO_COMx_GPI_REGS(n) \ + (ALIGN_UP((n), GPIO_MAX_NUM_PER_GROUP) / GPIO_MAX_NUM_PER_GROUP) + +#define NUM_GPIO_COM0_GPI_REGS NUM_GPIO_COMx_GPI_REGS(NUM_GPIO_COM0_PADS) +#define NUM_GPIO_COM1_GPI_REGS NUM_GPIO_COMx_GPI_REGS(NUM_GPIO_COM1_PADS) +#define NUM_GPIO_COM2_GPI_REGS NUM_GPIO_COMx_GPI_REGS(NUM_GPIO_COM2_PADS) +#define NUM_GPIO_COM3_GPI_REGS NUM_GPIO_COMx_GPI_REGS(NUM_GPIO_COM3_PADS) +#define NUM_GPIO_COM4_GPI_REGS NUM_GPIO_COMx_GPI_REGS(NUM_GPIO_COM4_PADS) +#define NUM_GPIO_COM5_GPI_REGS NUM_GPIO_COMx_GPI_REGS(NUM_GPIO_COM5_PADS) + +#define NUM_GPI_STATUS_REGS \ + ((NUM_GPIO_COM0_GPI_REGS) +\ + (NUM_GPIO_COM1_GPI_REGS) +\ + (NUM_GPIO_COM2_GPI_REGS) +\ + (NUM_GPIO_COM4_GPI_REGS) +\ + (NUM_GPIO_COM5_GPI_REGS)) + +#define PAD_CFG_LOCK_OFFSET 0x110 + +/* + * IOxAPIC IRQs for the GPIOs + */ + +/* Group I */ +#define GPP_I0_IRQ 0x18 +#define GPP_I1_IRQ 0x19 +#define GPP_I2_IRQ 0x1A +#define GPP_I3_IRQ 0x1B +#define GPP_I4_IRQ 0x1C +#define GPP_I5_IRQ 0x1D +#define GPP_I6_IRQ 0x1E +#define GPP_I7_IRQ 0x20 +#define GPP_I8_IRQ 0x21 +#define GPP_I9_IRQ 0x22 +#define GPP_I10_IRQ 0x23 +#define GPP_I11_IRQ 0x24 +#define GPP_I12_IRQ 0x25 +#define GPP_I13_IRQ 0x26 +#define GPP_I14_IRQ 0x27 +#define GPP_I15_IRQ 0x28 +#define GPP_I16_IRQ 0x29 +#define GPP_I17_IRQ 0x2A +#define GPP_I18_IRQ 0x2B +#define GPP_I19_IRQ 0x2C +#define GPP_I20_IRQ 0x2D +#define GPP_I21_IRQ 0x2E +#define GPP_I22_IRQ 0x30 + +/* Group R */ +#define GPP_R0_IRQ 0x31 +#define GPP_R1_IRQ 0x32 +#define GPP_R2_IRQ 0x33 +#define GPP_R3_IRQ 0x34 +#define GPP_R4_IRQ 0x35 +#define GPP_R5_IRQ 0x36 +#define GPP_R6_IRQ 0x37 +#define GPP_R7_IRQ 0x38 +#define GPP_R8_IRQ 0x39 +#define GPP_R9_IRQ 0x3A +#define GPP_R10_IRQ 0x3B +#define GPP_R11_IRQ 0x3C +#define GPP_R12_IRQ 0x3D +#define GPP_R13_IRQ 0x3E +#define GPP_R14_IRQ 0x3F +#define GPP_R15_IRQ 0x40 +#define GPP_R16_IRQ 0x41 +#define GPP_R17_IRQ 0x42 +#define GPP_R18_IRQ 0x43 +#define GPP_R19_IRQ 0x44 +#define GPP_R20_IRQ 0x45 +#define GPP_R21_IRQ 0x46 + +/* Group J */ +#define GPP_J0_IRQ 0x47 +#define GPP_J1_IRQ 0x48 +#define GPP_J2_IRQ 0x49 +#define GPP_J3_IRQ 0x4A +#define GPP_J4_IRQ 0x4B +#define GPP_J5_IRQ 0x4C +#define GPP_J6_IRQ 0x4D +#define GPP_J7_IRQ 0x4E +#define GPP_J8_IRQ 0x50 +#define GPP_J9_IRQ 0x51 +#define GPP_J10_IRQ 0x52 +#define GPP_J11_IRQ 0x53 + +/* Group B */ +#define GPP_B0_IRQ 0x50 +#define GPP_B1_IRQ 0x51 +#define GPP_B2_IRQ 0x52 +#define GPP_B3_IRQ 0x53 +#define GPP_B4_IRQ 0x54 +#define GPP_B5_IRQ 0x55 +#define GPP_B6_IRQ 0x56 +#define GPP_B7_IRQ 0x57 +#define GPP_B8_IRQ 0x58 +#define GPP_B9_IRQ 0x59 +#define GPP_B10_IRQ 0x5A +#define GPP_B11_IRQ 0x5B +#define GPP_B12_IRQ 0x5C +#define GPP_B13_IRQ 0x5D +#define GPP_B14_IRQ 0x5E +#define GPP_B15_IRQ 0x5F +#define GPP_B16_IRQ 0x60 +#define GPP_B17_IRQ 0x61 +#define GPP_B18_IRQ 0x62 +#define GPP_B19_IRQ 0x63 +#define GPP_B20_IRQ 0x64 +#define GPP_B21_IRQ 0x65 +#define GPP_B22_IRQ 0x66 +#define GPP_B23_IRQ 0x67 + +/* Group G */ +#define GPP_G0_IRQ 0x68 +#define GPP_G1_IRQ 0x69 +#define GPP_G2_IRQ 0x6A +#define GPP_G3_IRQ 0x6B +#define GPP_G4_IRQ 0x6C +#define GPP_G5_IRQ 0x6D +#define GPP_G6_IRQ 0x6E +#define GPP_G7_IRQ 0x6F + +/* Group H */ +#define GPP_H0_IRQ 0x70 +#define GPP_H1_IRQ 0x71 +#define GPP_H2_IRQ 0x72 +#define GPP_H3_IRQ 0x73 +#define GPP_H4_IRQ 0x74 +#define GPP_H5_IRQ 0x75 +#define GPP_H6_IRQ 0x76 +#define GPP_H7_IRQ 0x77 +#define GPP_H8_IRQ 0x18 +#define GPP_H9_IRQ 0x19 +#define GPP_H10_IRQ 0x20 +#define GPP_H11_IRQ 0x21 +#define GPP_H12_IRQ 0x22 +#define GPP_H13_IRQ 0x23 +#define GPP_H14_IRQ 0x24 +#define GPP_H15_IRQ 0x25 +#define GPP_H16_IRQ 0x26 +#define GPP_H17_IRQ 0x27 +#define GPP_H18_IRQ 0x28 +#define GPP_H19_IRQ 0x29 +#define GPP_H20_IRQ 0x2A +#define GPP_H21_IRQ 0x2B +#define GPP_H22_IRQ 0x2C +#define GPP_H23_IRQ 0x2D + +/* Group GPD */ +#define GPD0_IRQ 0x60 +#define GPD1_IRQ 0x61 +#define GPD2_IRQ 0x62 +#define GPD3_IRQ 0x63 +#define GPD4_IRQ 0x64 +#define GPD5_IRQ 0x65 +#define GPD6_IRQ 0x66 +#define GPD7_IRQ 0x67 +#define GPD8_IRQ 0x68 +#define GPD9_IRQ 0x69 +#define GPD10_IRQ 0x6A +#define GPD11_IRQ 0x6B +#define GPD12_IRQ 0x6C + +/* Group A */ +#define GPP_A0_IRQ 0x18 +#define GPP_A1_IRQ 0x19 +#define GPP_A2_IRQ 0x20 +#define GPP_A3_IRQ 0x21 +#define GPP_A4_IRQ 0x22 +#define GPP_A5_IRQ 0x23 +#define GPP_A6_IRQ 0x24 +#define GPP_A7_IRQ 0x25 +#define GPP_A8_IRQ 0x26 +#define GPP_A9_IRQ 0x27 +#define GPP_A10_IRQ 0x28 +#define GPP_A11_IRQ 0x29 +#define GPP_A12_IRQ 0x2A +#define GPP_A13_IRQ 0x2B +#define GPP_A14_IRQ 0x2C + +/* Group C */ +#define GPP_C0_IRQ 0x2D +#define GPP_C1_IRQ 0x2E +#define GPP_C2_IRQ 0x2F +#define GPP_C3_IRQ 0x30 +#define GPP_C4_IRQ 0x31 +#define GPP_C5_IRQ 0x32 +#define GPP_C6_IRQ 0x33 +#define GPP_C7_IRQ 0x34 +#define GPP_C8_IRQ 0x35 +#define GPP_C9_IRQ 0x36 +#define GPP_C10_IRQ 0x37 +#define GPP_C11_IRQ 0x38 +#define GPP_C12_IRQ 0x39 +#define GPP_C13_IRQ 0x3A +#define GPP_C14_IRQ 0x3B +#define GPP_C15_IRQ 0x3C +#define GPP_C16_IRQ 0x3D +#define GPP_C17_IRQ 0x3E +#define GPP_C18_IRQ 0x3F +#define GPP_C19_IRQ 0x40 +#define GPP_C20_IRQ 0x41 +#define GPP_C21_IRQ 0x42 +#define GPP_C22_IRQ 0x43 +#define GPP_C23_IRQ 0x44 + +/* Group S */ +#define GPP_S0_IRQ 0x30 +#define GPP_S1_IRQ 0x31 +#define GPP_S2_IRQ 0x32 +#define GPP_S3_IRQ 0x33 +#define GPP_S4_IRQ 0x34 +#define GPP_S5_IRQ 0x35 +#define GPP_S6_IRQ 0x36 +#define GPP_S7_IRQ 0x37 + +/* Group E */ +#define GPP_E0_IRQ 0x38 +#define GPP_E1_IRQ 0x39 +#define GPP_E2_IRQ 0x3A +#define GPP_E3_IRQ 0x3B +#define GPP_E4_IRQ 0x3C +#define GPP_E5_IRQ 0x3D +#define GPP_E6_IRQ 0x3E +#define GPP_E7_IRQ 0x3F +#define GPP_E8_IRQ 0x40 +#define GPP_E9_IRQ 0x41 +#define GPP_E10_IRQ 0x42 +#define GPP_E11_IRQ 0x43 +#define GPP_E12_IRQ 0x44 +#define GPP_E13_IRQ 0x45 +#define GPP_E14_IRQ 0x46 +#define GPP_E15_IRQ 0x47 +#define GPP_E16_IRQ 0x48 +#define GPP_E17_IRQ 0x49 +#define GPP_E18_IRQ 0x4A +#define GPP_E19_IRQ 0x4B +#define GPP_E20_IRQ 0x4C +#define GPP_E21_IRQ 0x4D + +/* Group K */ +#define GPP_K0_IRQ 0x4E +#define GPP_K1_IRQ 0x50 +#define GPP_K2_IRQ 0x51 +#define GPP_K3_IRQ 0x52 +#define GPP_K4_IRQ 0x53 +#define GPP_K5_IRQ 0x54 +#define GPP_K6_IRQ 0x55 +#define GPP_K7_IRQ 0x56 +#define GPP_K8_IRQ 0x57 +#define GPP_K9_IRQ 0x58 +#define GPP_K10_IRQ 0x59 +#define GPP_K11_IRQ 0x5A + +/* Group F */ +#define GPP_F0_IRQ 0x5B +#define GPP_F1_IRQ 0x5C +#define GPP_F2_IRQ 0x5D +#define GPP_F3_IRQ 0x5E +#define GPP_F4_IRQ 0x60 +#define GPP_F5_IRQ 0x61 +#define GPP_F6_IRQ 0x62 +#define GPP_F7_IRQ 0x63 +#define GPP_F8_IRQ 0x64 +#define GPP_F9_IRQ 0x65 +#define GPP_F10_IRQ 0x66 +#define GPP_F11_IRQ 0x67 +#define GPP_F12_IRQ 0x68 +#define GPP_F13_IRQ 0x69 +#define GPP_F14_IRQ 0x6A +#define GPP_F15_IRQ 0x6B +#define GPP_F16_IRQ 0x6C +#define GPP_F17_IRQ 0x6D +#define GPP_F18_IRQ 0x6E +#define GPP_F19_IRQ 0x6F +#define GPP_F20_IRQ 0x70 +#define GPP_F21_IRQ 0x71 +#define GPP_F22_IRQ 0x72 +#define GPP_F23_IRQ 0x73 + +/* Group D */ +#define GPP_D0_IRQ 0x70 +#define GPP_D1_IRQ 0x71 +#define GPP_D2_IRQ 0x72 +#define GPP_D3_IRQ 0x73 +#define GPP_D4_IRQ 0x74 +#define GPP_D5_IRQ 0x75 +#define GPP_D6_IRQ 0x76 +#define GPP_D7_IRQ 0x77 +#define GPP_D8_IRQ 0x18 +#define GPP_D9_IRQ 0x19 +#define GPP_D10_IRQ 0x20 +#define GPP_D11_IRQ 0x21 +#define GPP_D12_IRQ 0x22 +#define GPP_D13_IRQ 0x23 +#define GPP_D14_IRQ 0x24 +#define GPP_D15_IRQ 0x25 +#define GPP_D16_IRQ 0x26 +#define GPP_D17_IRQ 0x27 +#define GPP_D18_IRQ 0x28 +#define GPP_D19_IRQ 0x29 +#define GPP_D20_IRQ 0x2A +#define GPP_D21_IRQ 0x2B +#define GPP_D22_IRQ 0x2C +#define GPP_D23_IRQ 0x2D + +/* Register defines. */ +#define GPIO_MISCCFG 0x10 +#define GPE_DW_SHIFT 8 +#define GPE_DW_MASK 0xfff00 +#define HOSTSW_OWN_REG_0 0x150 +#define GPI_INT_STS_0 0x200 +#define GPI_INT_EN_0 0x220 +#define GPI_SMI_STS_0 0x280 +#define GPI_SMI_EN_0 0x2A0 +#define PAD_CFG_BASE 0x700 + +#endif diff --git a/src/soc/intel/alderlake/include/soc/gpio_soc_defs_pch_s.h b/src/soc/intel/alderlake/include/soc/gpio_soc_defs_pch_s.h new file mode 100644 index 0000000000..704b9a7233 --- /dev/null +++ b/src/soc/intel/alderlake/include/soc/gpio_soc_defs_pch_s.h @@ -0,0 +1,525 @@ +/* SPDX-License-Identifier: GPL-2.0-only */ +#ifndef _SOC_ALDERLAKE_GPIO_SOC_DEFS_PCH_S_H_ +#define _SOC_ALDERLAKE_GPIO_SOC_DEFS_PCH_S_H_ + +#define INC(x) ((x) + 1) +/* + * Most of the fixed numbers and macros are based on the GPP groups. + * The GPIO groups are accessed through register blocks called + * communities. + * + * Refer to Alder Lake PCH-S EDS Chapter 26, MISCCFG register offset 0x10 + * for each GPIO community to get GPIO group to GPE_DWx assignment. + */ +#define GPP_I 0x0 +#define GPP_R INC(GPP_I) +#define GPP_J INC(GPP_R) +#define GPP_VPGIO INC(GPP_J) +#define GPD INC(GPP_VPGIO) +#define GPP_D INC(GPD) +#define GPP_S INC(GPP_D) +#define GPP_E INC(GPP_S) +#define GPP_K INC(GPP_E) +#define GPP_F INC(GPP_K) +#define GPP_A INC(GPP_F) +#define GPP_C INC(GPP_A) +#define GPP_B INC(GPP_C) +#define GPP_G INC(GPP_B) +#define GPP_H INC(GPP_G) + +#define GPIO_MAX_NUM_PER_GROUP 26 + +#define COMM_0 0 +#define COMM_1 INC(COMM_0) +#define COMM_2 INC(COMM_1) +#define COMM_3 INC(COMM_2) +#define COMM_4 INC(COMM_3) +#define COMM_5 INC(COMM_4) + +/* Group I */ +#define GPP_I0 0 +#define GPP_I1 INC(GPP_I0) +#define GPP_I2 INC(GPP_I1) +#define GPP_I3 INC(GPP_I2) +#define GPP_I4 INC(GPP_I3) +#define GPP_I5 INC(GPP_I4) +#define GPP_I6 INC(GPP_I5) +#define GPP_I7 INC(GPP_I6) +#define GPP_I8 INC(GPP_I7) +#define GPP_I9 INC(GPP_I8) +#define GPP_I10 INC(GPP_I9) +#define GPP_I11 INC(GPP_I10) +#define GPP_I12 INC(GPP_I11) +#define GPP_I13 INC(GPP_I12) +#define GPP_I14 INC(GPP_I13) +#define GPP_I15 INC(GPP_I14) +#define GPP_I16 INC(GPP_I15) +#define GPP_I17 INC(GPP_I16) +#define GPP_I18 INC(GPP_I17) +#define GPP_I19 INC(GPP_I18) +#define GPP_I20 INC(GPP_I19) +#define GPP_I21 INC(GPP_I20) +#define GPP_I22 INC(GPP_I21) +#define GPP_GSPI0_CLK_LOOPBK INC(GPP_I22) +#define GPP_GSPI1_CLK_LOOPBK INC(GPP_GSPI0_CLK_LOOPBK) + +/* Group R */ +#define GPP_R0 INC(GPP_GSPI1_CLK_LOOPBK) +#define GPP_R1 INC(GPP_R0) +#define GPP_R2 INC(GPP_R1) +#define GPP_R3 INC(GPP_R2) +#define GPP_R4 INC(GPP_R3) +#define GPP_R5 INC(GPP_R4) +#define GPP_R6 INC(GPP_R5) +#define GPP_R7 INC(GPP_R6) +#define GPP_R8 INC(GPP_R7) +#define GPP_R9 INC(GPP_R8) +#define GPP_R10 INC(GPP_R9) +#define GPP_R11 INC(GPP_R10) +#define GPP_R12 INC(GPP_R11) +#define GPP_R13 INC(GPP_R12) +#define GPP_R14 INC(GPP_R13) +#define GPP_R15 INC(GPP_R14) +#define GPP_R16 INC(GPP_R15) +#define GPP_R17 INC(GPP_R16) +#define GPP_R18 INC(GPP_R17) +#define GPP_R19 INC(GPP_R18) +#define GPP_R20 INC(GPP_R19) +#define GPP_R21 INC(GPP_R20) +#define GPP_GSPI2_CLK_LOOPBK INC(GPP_R21) + +/* Group J */ +#define GPP_J0 INC(GPP_GSPI2_CLK_LOOPBK) +#define GPP_J1 INC(GPP_J0) +#define GPP_J2 INC(GPP_J1) +#define GPP_J3 INC(GPP_J2) +#define GPP_J4 INC(GPP_J3) +#define GPP_J5 INC(GPP_J4) +#define GPP_J6 INC(GPP_J5) +#define GPP_J7 INC(GPP_J6) +#define GPP_J8 INC(GPP_J7) +#define GPP_J9 INC(GPP_J8) +#define GPP_J10 INC(GPP_J9) +#define GPP_J11 INC(GPP_J10) + +/* Group vGPIO */ +#define VGPIO_0 INC(GPP_J11) +#define VGPIO_4 INC(VGPIO_0) +#define VGPIO_5 INC(VGPIO_4) +#define VGPIO_6 INC(VGPIO_5) +#define VGPIO_7 INC(VGPIO_6) +#define VGPIO_8 INC(VGPIO_7) +#define VGPIO_9 INC(VGPIO_8) +#define VGPIO_10 INC(VGPIO_9) +#define VGPIO_11 INC(VGPIO_10) +#define VGPIO_12 INC(VGPIO_11) +#define VGPIO_13 INC(VGPIO_12) +#define VGPIO_18 INC(VGPIO_13) +#define VGPIO_19 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