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path: root/src/soc/intel/fsp_broadwell_de/include/soc/pci_devs.h
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/*
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 */

#ifndef _SOC_PCI_DEVS_H_
#define _SOC_PCI_DEVS_H_

#include <device/pci_def.h>

#define BUS0 0

#define SOC_DEV                 0
#define SOC_FUNC                0
#define SOC_DEVID               0x2F00
#define SOC_DEVID_ES2           0x6F00
#define SOC_DEV_FUNC PCI_DEVFN(SOC_DEV, SOC_FUNC)

#define LPC_DEV                 31
#define LPC_FUNC                0
#define LPC_DEVID               0x8C42
#define LPC_DEVID_ES2           0x8C54
#define LPC_DEV_FUNC PCI_DEVFN(LPC_DEV, LPC_FUNC)

#define SATA_DEV                31
#define SATA_FUNC               2
#define AHCI_DEVID              0x8C02
#define SATA_DEV_FUNC PCI_DEVFN(SATA_DEV, SATA_FUNC)

#define SATA2_DEV               31
#define SATA2_FUNC              5
#define SATA2_DEV_FUNC PCI_DEVFN(SATA2_DEV, SATA2_FUNC)

#define EHCI1_DEV               29
#define EHCI1_FUNC              0
#define EHCI1_DEVID             0x8C26
#define EHCI1_DEV_FUNC PCI_DEVFN(EHCI_DEV1, EHCI_FUNC1)

#define EHCI2_DEV               26
#define EHCI2_FUNC              0
#define EHCI2_DEVID             0x8C2D
#define EHCI2_DEV_FUNC PCI_DEVFN(EHCI_DEV2, EHCI_FUNC2)

#define XHCI_DEV                20
#define XHCI_FUNC               0
#define XHCI_DEVID              0x8C31
#define XHCI_FUS_REG            0xE0
#define XHCI_FUNC_DISABLE       (1 << 0)
#define XHCI_USB2PR_REG         0xD0
#define XHCI_DEV_FUNC PCI_DEVFN(XHCI_DEV, XHCI_FUNC)

#define GBE_DEV                 25
#define GBE_FUNC                0
#define GBE_DEVID               0x8C33
#define GBE_DEV_FUNC PCI_DEVFN(GBE_DEV, GBE_FUNC)

#define ME_DEV                  22
#define ME_FUNC                 0
#define ME_DEVID                0x8C3A
#define ME_DEV_FUNC PCI_DEVFN(ME_DEV, ME_FUNC)

#define HDA_DEV                 27
#define HDA_FUNC                0
#define HDA_DEVID               0x8C20
#define HDA_DEV_FUNC PCI_DEVFN(HDA_DEV, HDA_FUNC)

#define PCIE_DEV                28
#define PCIE_PORT1_DEV          PCIE_DEV
#define PCIE_PORT1_FUNC         0
#define PCIE_PORT1_DEVID        0x8C10
#define PCIE_PORT2_DEV          PCIE_DEV
#define PCIE_PORT2_FUNC         1
#define PCIE_PORT2_DEVID        0x8C12
#define PCIE_PORT3_DEV          PCIE_DEV
#define PCIE_PORT3_FUNC         2
#define PCIE_PORT3_DEVID        0x8C14
#define PCIE_PORT4_DEV          PCIE_DEV
#define PCIE_PORT4_FUNC         3
#define PCIE_PORT4_DEVID        0x8C16
#define PCIE_PORT5_DEV          PCIE_DEV
#define PCIE_PORT5_FUNC         4
#define PCIE_PORT5_DEVID        0x8C18
#define PCIE_PORT6_DEV          PCIE_DEV
#define PCIE_PORT6_FUNC         5
#define PCIE_PORT6_DEVID        0x8C1A
#define PCIE_PORT7_DEV          PCIE_DEV
#define PCIE_PORT7_FUNC         6
#define PCIE_PORT7_DEVID        0x8C1C
#define PCIE_PORT8_DEV          PCIE_DEV
#define PCIE_PORT8_FUNC         7
#define PCIE_PORT8_DEVID        0x8C1E
#define PCIE_PORT1_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT1_FUNC)
#define PCIE_PORT2_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT2_FUNC)
#define PCIE_PORT3_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT3_FUNC)
#define PCIE_PORT4_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT4_FUNC)
#define PCIE_PORT5_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT5_FUNC)
#define PCIE_PORT6_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT6_FUNC)
#define PCIE_PORT7_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT7_FUNC)
#define PCIE_PORT8_DEV_FUNC PCI_DEVFN(PCIE_DEV, PCIE_PORT8_FUNC)

#endif /* _SOC_PCI_DEVS_H_ */