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#include <southbridge/intel/common/gpio.h>
const struct pch_gpio_set1 pch_gpio_set1_mode = {
.gpio0 = GPIO_MODE_GPIO, // -USB30_SMIB - input
.gpio1 = GPIO_MODE_GPIO, // -EC_SCI - input
.gpio2 = GPIO_MODE_GPIO, // -LCD_PRESENCE - input
.gpio3 = GPIO_MODE_GPIO, // DOCKID0 - input
.gpio4 = GPIO_MODE_GPIO, // DOCKID1 - input
.gpio5 = GPIO_MODE_GPIO, // DOCKID2 - input
.gpio6 = GPIO_MODE_GPIO, // SYSTEM_DP_HPD - input
.gpio7 = GPIO_MODE_GPIO, // pullup
.gpio8 = GPIO_MODE_GPIO, // pulldown - INTEGRATED ENABLED(FCIM) 0 / DISABLED (BTM) 1
.gpio9 = GPIO_MODE_NATIVE, // OC5 - -USB_PORT9_OC5 - input
.gpio10 = GPIO_MODE_GPIO, // DRAMRST_GATE_ON - output
.gpio11 = GPIO_MODE_NATIVE, // SMBALERT# pullup
.gpio12 = GPIO_MODE_NATIVE, // LANPHYPC - output
.gpio13 = GPIO_MODE_GPIO, // -EC_WAKE - input
.gpio14 = GPIO_MODE_NATIVE, // OC7 - pullup
.gpio15 = GPIO_MODE_GPIO, // pullup - ME CRYPTO STRAP WITH TLS CONFIDENTIALITY
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.gpio17 = GPIO_MODE_GPIO, // DGFX_PW RGD - input
.gpio18 = GPIO_MODE_NATIVE, // PCIECLKRQ1 - -CLKREQ_WLAN - input
.gpio19 = GPIO_MODE_NATIVE, // SATA1GP - SATA_BAY_DTCT - input to gpio22
.gpio20 = GPIO_MODE_NATIVE, // PCIECLKRQ2 - pullup
.gpio21 = GPIO_MODE_GPIO, // -DISCRETE_GFX_PRESENCE - input
.gpio22 = GPIO_MODE_GPIO, // SATA_BAY_DTCT - output to SATA1GP
.gpio23 = GPIO_MODE_NATIVE, // LDRQ1 - TP84
.gpio24 = GPIO_MODE_GPIO, // pullup
.gpio25 = GPIO_MODE_NATIVE, // PCIECLKRQ3 - -CLKREQ_EXC - input
.gpio26 = GPIO_MODE_NATIVE, // PCIECLKRQ4 - pullup
.gpio27 = GPIO_MODE_GPIO, // -MSATA_DTCT - input
.gpio28 = GPIO_MODE_GPIO, // pulldown possible
.gpio29 = GPIO_MODE_GPIO, // SLP_LAN - -PCH_SLP_LAN
.gpio30 = GPIO_MODE_NATIVE, // SUSPWRDNACK - output
.gpio31 = GPIO_MODE_NATIVE, // ACPRESENT - input
};
const struct pch_gpio_set1 pch_gpio_set1_direction = {
.gpio0 = GPIO_DIR_INPUT,
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.gpio0 = GPIO_INVERT,
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.gpio13 = GPIO_INVERT,
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const struct pch_gpio_set2 pch_gpio_set2_mode = {
.gpio32 = GPIO_MODE_NATIVE, // CLKRUN - output
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.gpio34 = GPIO_MODE_GPIO, // DGFX_VRM_ID - input - HIGH: 1GB / LOW: 2GB
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.gpio37 = GPIO_MODE_GPIO, // pulldown
.gpio38 = GPIO_MODE_GPIO, // planarid2 - input - pulldown
.gpio39 = GPIO_MODE_GPIO, // planarid3 - input - pulldown
.gpio40 = GPIO_MODE_NATIVE, // OC1 - -USB_PORT1_OC1 - input
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.gpio42 = GPIO_MODE_GPIO, // SMB_3B_EN - output
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.gpio45 = GPIO_MODE_NATIVE, // PCIECLKRQ6 - -CLKREQ_USB30_TR - input
.gpio46 = GPIO_MODE_NATIVE, // PCIECLKRQ7 - pullup
.gpio47 = GPIO_MODE_NATIVE, // PEG_A_CLKRQ# - input
.gpio48 = GPIO_MODE_GPIO, // planarid0 - input - PDV low / FVT high
.gpio49 = GPIO_MODE_GPIO, // planarid1 - input - pulldown
.gpio50 = GPIO_MODE_GPIO, // -SC_DTCT - input
.gpio51 = GPIO_MODE_GPIO, // pullup
.gpio52 = GPIO_MODE_GPIO, // OPTIMUS_ENABLE - output - high: igpu / low: dgpu
.gpio53 = GPIO_MODE_GPIO, // pullup
.gpio54 = GPIO_MODE_GPIO, // -BDC_PRESENCE - input
.gpio55 = GPIO_MODE_GPIO, // pullup
.gpio56 = GPIO_MODE_NATIVE, // PEG_B_CLKRQ - pullup
.gpio57 = GPIO_MODE_GPIO, // -DTPM_PRESENCE - input
.gpio58 = GPIO_MODE_NATIVE, // SML1CLK - EC_SCL2 - output
.gpio59 = GPIO_MODE_NATIVE, // OC0 - pullup
.gpio60 = GPIO_MODE_NATIVE, // SML0ALERT# - pullup
.gpio61 = GPIO_MODE_NATIVE, // SUS_STAT - output
.gpio62 = GPIO_MODE_NATIVE, // SUSCLK - output
.gpio63 = GPIO_MODE_NATIVE, // SLP_S5 - output
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const struct pch_gpio_set2 pch_gpio_set2_direction = {
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const struct pch_gpio_set2 pch_gpio_set2_level = {
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const struct pch_gpio_set3 pch_gpio_set3_mode = {
.gpio64 = GPIO_MODE_NATIVE, // NC
.gpio65 = GPIO_MODE_NATIVE, // VIDEO_CLK_27M_NSS - output
.gpio66 = GPIO_MODE_NATIVE, // NC
.gpio67 = GPIO_MODE_NATIVE, // VIDEO_CLK_27M_SS - output
.gpio68 = GPIO_MODE_GPIO, // -INT_MIC_DTCT - input
.gpio69 = GPIO_MODE_GPIO, // mic enable bit - low enable - pulldown
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.gpio71 = GPIO_MODE_GPIO, // pullup
.gpio72 = GPIO_MODE_NATIVE, // BATLOW - input
.gpio73 = GPIO_MODE_NATIVE, // pullup
.gpio74 = GPIO_MODE_NATIVE, // pullup
.gpio75 = GPIO_MODE_NATIVE, // SML1DATA - EC_SDA2 - i/o
};
const struct pch_gpio_set3 pch_gpio_set3_direction = {
.gpio64 = GPIO_DIR_OUTPUT,
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.gpio66 = GPIO_DIR_OUTPUT,
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.gpio68 = GPIO_DIR_INPUT,
.gpio69 = GPIO_DIR_INPUT,
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const struct pch_gpio_set3 pch_gpio_set3_level = {
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};
const struct pch_gpio_map mainboard_gpio_map = {
.set1 = {
.mode = &pch_gpio_set1_mode,
.direction = &pch_gpio_set1_direction,
.level = &pch_gpio_set1_level,
.invert = &pch_gpio_set1_invert,
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.set2 = {
.mode = &pch_gpio_set2_mode,
.direction = &pch_gpio_set2_direction,
.level = &pch_gpio_set2_level,
},
.set3 = {
.mode = &pch_gpio_set3_mode,
.direction = &pch_gpio_set3_direction,
.level = &pch_gpio_set3_level,
},
};
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