google/gru: add MAX_SDRAM_FREQ config to choose max ddr freq

Gru/Kevin use 933 MHz (actually 928 MHz for better jitter) as max sdram
frequency, while bob uses 800 MHz.

It's normal some variants can't meet 928 MHz SI requirement and hence
have to use a lower freq as spec.

BUG=chrome-os-partner:61001
BRANCH=gru
TEST=check dpll is 800 MHz on bob

Change-Id: I6d19a351f25d1f48547715ce57c3a87d9505f6f1
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Original-Change-Id: I46afba8d091f1489feeb20cafc44decaa81601fc
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Original-Tested-by: Shasha Zhao <Sarah_Zhao@asus.com>
Original-(cherry picked from commit eba5dff79eeedae5ff608d2d8d297ccf9c13cb55)
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diff --git a/src/mainboard/google/gru/Kconfig b/src/mainboard/google/gru/Kconfig
index 6361baca05..3048b01891 100644
--- a/src/mainboard/google/gru/Kconfig
+++ b/src/mainboard/google/gru/Kconfig
@@ -91,6 +91,13 @@ config MAINBOARD_PART_NUMBER
 	default "Gru" if BOARD_GOOGLE_GRU
 	default "Kevin" if BOARD_GOOGLE_KEVIN
 
+# The default max sdram freq is 933M(actually 928M dpll), and
+# 800M is another choice.
+config MAX_SDRAM_FREQ
+	int
+	default 800 if BOARD_GOOGLE_BOB
+	default 933
+
 config GBB_HWID
 	string
 	depends on CHROMEOS
diff --git a/src/mainboard/google/gru/Makefile.inc b/src/mainboard/google/gru/Makefile.inc
index 122139dd15..d54ce2f0f6 100644
--- a/src/mainboard/google/gru/Makefile.inc
+++ b/src/mainboard/google/gru/Makefile.inc
@@ -13,7 +13,7 @@
 ## GNU General Public License for more details.
 ##
 
-subdirs-y += sdram_params/
+subdirs-y += sdram_params_$(CONFIG_MAX_SDRAM_FREQ)/
 
 bootblock-y += bootblock.c
 bootblock-y += chromeos.c
diff --git a/src/mainboard/google/gru/sdram_params_800/Makefile.inc b/src/mainboard/google/gru/sdram_params_800/Makefile.inc
new file mode 100644
index 0000000000..ca7b52b0ec
--- /dev/null
+++ b/src/mainboard/google/gru/sdram_params_800/Makefile.inc
@@ -0,0 +1,27 @@
+##
+## This file is part of the coreboot project.
+##
+## Copyright 2017 Rockchip Inc.
+##
+## This program is free software; you can redistribute it and/or modify
+## it under the terms of the GNU General Public License as published by
+## the Free Software Foundation; version 2 of the License.
+##
+## This program is distributed in the hope that it will be useful,
+## but WITHOUT ANY WARRANTY; without even the implied warranty of
+## MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+## GNU General Public License for more details.
+##
+
+sdram-params :=
+sdram-params += sdram-lpddr3-samsung-2GB-24EB
+sdram-params += sdram-lpddr3-micron-2GB
+sdram-params += sdram-lpddr3-samsung-4GB-04EB
+sdram-params += sdram-lpddr3-micron-4GB
+
+$(foreach params,$(sdram-params), \
+	$(eval cbfs-files-y += $(params)) \
+	$(eval $(params)-file := $(params).c:struct) \
+	$(eval $(params)-type := struct) \
+	$(eval $(params)-compression := $(CBFS_COMPRESS_FLAG)) \
+)
diff --git a/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-micron-2GB.c b/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-micron-2GB.c
new file mode 100644
index 0000000000..062df3a418
--- /dev/null
+++ b/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-micron-2GB.c
@@ -0,0 +1,1566 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ */
+
+#include <soc/sdram.h>
+
+/* 2 MICRON MT52L256M32D1PF chips */
+struct rk3399_sdram_params params = {
+	{
+		{
+			.rank = 0x1,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
+			.dbw = 0x2,
+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x801d181e},
+				{0x17050a08},
+				{0x00000002},
+				{0x00006426},
+				{0x0000004c},
+				0x00000000
+			}
+		},
+		{
+			.rank = 0x1,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
+			.dbw = 0x2,
+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x801d181e},
+				{0x17050a08},
+				{0x00000002},
+				{0x00006426},
+				{0x0000004c},
+				0x00000000
+			}
+		}
+	},
+	.ddr_freq = 800*MHz,
+	.dramtype = LPDDR3,
+	.num_channels = 2,
+	.stride = 9,
+	.odt = 1,
+	{
+		{
+			0x00000700,	/* DENALI_CTL_00_DATA */
+			0x00000000,	/* DENALI_CTL_01_DATA */
+			0x00000000,	/* DENALI_CTL_02_DATA */
+			0x00000000,	/* DENALI_CTL_03_DATA */
+			0x00000000,	/* DENALI_CTL_04_DATA */
+			0x00000050,	/* DENALI_CTL_05_DATA */
+			0x00027100,	/* DENALI_CTL_06_DATA */
+			0x00000320,	/* DENALI_CTL_07_DATA */
+			0x00001f40,	/* DENALI_CTL_08_DATA */
+			0x00000050,	/* DENALI_CTL_09_DATA */
+			0x00027100,	/* DENALI_CTL_10_DATA */
+			0x00000320,	/* DENALI_CTL_11_DATA */
+			0x00001f40,	/* DENALI_CTL_12_DATA */
+			0x00000050,	/* DENALI_CTL_13_DATA */
+			0x00027100,	/* DENALI_CTL_14_DATA */
+			0x00000320,	/* DENALI_CTL_15_DATA */
+			0x01001f40,	/* DENALI_CTL_16_DATA */
+			0x00000000,	/* DENALI_CTL_17_DATA */
+			0x00000101,	/* DENALI_CTL_18_DATA */
+			0x00020100,	/* DENALI_CTL_19_DATA */
+			0x000000a0,	/* DENALI_CTL_20_DATA */
+			0x00000190,	/* DENALI_CTL_21_DATA */
+			0x00000000,	/* DENALI_CTL_22_DATA */
+			0x06180000,	/* DENALI_CTL_23_DATA */
+			0x00061800,	/* DENALI_CTL_24_DATA */
+			0x04000618,	/* DENALI_CTL_25_DATA */
+			0x33080004,	/* DENALI_CTL_26_DATA */
+			0x280f0622,	/* DENALI_CTL_27_DATA */
+			0x22330800,	/* DENALI_CTL_28_DATA */
+			0x00280f06,	/* DENALI_CTL_29_DATA */
+			0x06223308,	/* DENALI_CTL_30_DATA */
+			0x0600280f,	/* DENALI_CTL_31_DATA */
+			0x00000a0a,	/* DENALI_CTL_32_DATA */
+			0x0600dac0,	/* DENALI_CTL_33_DATA */
+			0x0a0a060c,	/* DENALI_CTL_34_DATA */
+			0x0600dac0,	/* DENALI_CTL_35_DATA */
+			0x0a0a060c,	/* DENALI_CTL_36_DATA */
+			0x0600dac0,	/* DENALI_CTL_37_DATA */
+			0x0203000c,	/* DENALI_CTL_38_DATA */
+			0x0f0c0f00,	/* DENALI_CTL_39_DATA */
+			0x040c0f0c,	/* DENALI_CTL_40_DATA */
+			0x14000a0a,	/* DENALI_CTL_41_DATA */
+			0x03030a0a,	/* DENALI_CTL_42_DATA */
+			0x00010003,	/* DENALI_CTL_43_DATA */
+			0x031b1b1b,	/* DENALI_CTL_44_DATA */
+			0x00111111,	/* DENALI_CTL_45_DATA */
+			0x00000000,	/* DENALI_CTL_46_DATA */
+			0x03010000,	/* DENALI_CTL_47_DATA */
+			0x0c2800a8,	/* DENALI_CTL_48_DATA */
+			0x0c2800a8,	/* DENALI_CTL_49_DATA */
+			0x0c2800a8,	/* DENALI_CTL_50_DATA */
+			0x00000000,	/* DENALI_CTL_51_DATA */
+			0x00060006,	/* DENALI_CTL_52_DATA */
+			0x00140006,	/* DENALI_CTL_53_DATA */
+			0x00140014,	/* DENALI_CTL_54_DATA */
+			0x000f0f0f,	/* DENALI_CTL_55_DATA */
+			0x00000000,	/* DENALI_CTL_56_DATA */
+			0x00000000,	/* DENALI_CTL_57_DATA */
+			0x00000000,	/* DENALI_CTL_58_DATA */
+			0x00b00000,	/* DENALI_CTL_59_DATA */
+			0x00b000b0,	/* DENALI_CTL_60_DATA */
+			0x00b000b0,	/* DENALI_CTL_61_DATA */
+			0x000000b0,	/* DENALI_CTL_62_DATA */
+			0x00000000,	/* DENALI_CTL_63_DATA */
+			0x00000000,	/* DENALI_CTL_64_DATA */
+			0x00000000,	/* DENALI_CTL_65_DATA */
+			0x00000000,	/* DENALI_CTL_66_DATA */
+			0x00000000,	/* DENALI_CTL_67_DATA */
+			0x00000000,	/* DENALI_CTL_68_DATA */
+			0x00000301,	/* DENALI_CTL_69_DATA */
+			0x00000001,	/* DENALI_CTL_70_DATA */
+			0x00000000,	/* DENALI_CTL_71_DATA */
+			0x00000000,	/* DENALI_CTL_72_DATA */
+			0x01000000,	/* DENALI_CTL_73_DATA */
+			0x80104002,	/* DENALI_CTL_74_DATA */
+			0x00040003,	/* DENALI_CTL_75_DATA */
+			0x00040005,	/* DENALI_CTL_76_DATA */
+			0x00030000,	/* DENALI_CTL_77_DATA */
+			0x00050004,	/* DENALI_CTL_78_DATA */
+			0x00000004,	/* DENALI_CTL_79_DATA */
+			0x00040003,	/* DENALI_CTL_80_DATA */
+			0x00040005,	/* DENALI_CTL_81_DATA */
+			0x30a00000,	/* DENALI_CTL_82_DATA */
+			0x00001850,	/* DENALI_CTL_83_DATA */
+			0x185030a0,	/* DENALI_CTL_84_DATA */
+			0x30a00000,	/* DENALI_CTL_85_DATA */
+			0x00001850,	/* DENALI_CTL_86_DATA */
+			0x00000000,	/* DENALI_CTL_87_DATA */
+			0x00000000,	/* DENALI_CTL_88_DATA */
+			0x00000000,	/* DENALI_CTL_89_DATA */
+			0x00000000,	/* DENALI_CTL_90_DATA */
+			0x00000000,	/* DENALI_CTL_91_DATA */
+			0x02020200,	/* DENALI_CTL_92_DATA */
+			0x00020202,	/* DENALI_CTL_93_DATA */
+			0x00030200,	/* DENALI_CTL_94_DATA */
+			0x00040700,	/* DENALI_CTL_95_DATA */
+			0x00000302,	/* DENALI_CTL_96_DATA */
+			0x02000407,	/* DENALI_CTL_97_DATA */
+			0x00000003,	/* DENALI_CTL_98_DATA */
+			0x00030f04,	/* DENALI_CTL_99_DATA */
+			0x00070004,	/* DENALI_CTL_100_DATA */
+			0x00000000,	/* DENALI_CTL_101_DATA */
+			0x00000000,	/* DENALI_CTL_102_DATA */
+			0x00000000,	/* DENALI_CTL_103_DATA */
+			0x00000000,	/* DENALI_CTL_104_DATA */
+			0x00000000,	/* DENALI_CTL_105_DATA */
+			0x00000000,	/* DENALI_CTL_106_DATA */
+			0x00000000,	/* DENALI_CTL_107_DATA */
+			0x00010000,	/* DENALI_CTL_108_DATA */
+			0x20040020,	/* DENALI_CTL_109_DATA */
+			0x00200400,	/* DENALI_CTL_110_DATA */
+			0x01000400,	/* DENALI_CTL_111_DATA */
+			0x00000b80,	/* DENALI_CTL_112_DATA */
+			0x00000000,	/* DENALI_CTL_113_DATA */
+			0x00000001,	/* DENALI_CTL_114_DATA */
+			0x00000002,	/* DENALI_CTL_115_DATA */
+			0x0000000e,	/* DENALI_CTL_116_DATA */
+			0x00000000,	/* DENALI_CTL_117_DATA */
+			0x00000000,	/* DENALI_CTL_118_DATA */
+			0x00000000,	/* DENALI_CTL_119_DATA */
+			0x00000000,	/* DENALI_CTL_120_DATA */
+			0x00000000,	/* DENALI_CTL_121_DATA */
+			0x00a00000,	/* DENALI_CTL_122_DATA */
+			0x00c80050,	/* DENALI_CTL_123_DATA */
+			0x00c80000,	/* DENALI_CTL_124_DATA */
+			0x005000a0,	/* DENALI_CTL_125_DATA */
+			0x000000c8,	/* DENALI_CTL_126_DATA */
+			0x00a000c8,	/* DENALI_CTL_127_DATA */
+			0x00c80050,	/* DENALI_CTL_128_DATA */
+			0x00c80000,	/* DENALI_CTL_129_DATA */
+			0x00000000,	/* DENALI_CTL_130_DATA */
+			0x00000000,	/* DENALI_CTL_131_DATA */
+			0x00000000,	/* DENALI_CTL_132_DATA */
+			0x00430000,	/* DENALI_CTL_133_DATA */
+			0x0000001a,	/* DENALI_CTL_134_DATA */
+			0x001a0043,	/* DENALI_CTL_135_DATA */
+			0x00430000,	/* DENALI_CTL_136_DATA */
+			0x0000001a,	/* DENALI_CTL_137_DATA */
+			0x00010001,	/* DENALI_CTL_138_DATA */
+			0x06000001,	/* DENALI_CTL_139_DATA */
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+			0x00000000,	/* DENALI_CTL_142_DATA */
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+			0x00000000,	/* DENALI_CTL_145_DATA */
+			0x00000000,	/* DENALI_CTL_146_DATA */
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+			0x06000001,	/* DENALI_CTL_153_DATA */
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+			0x00000000,	/* DENALI_CTL_156_DATA */
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+			0x00000000,	/* DENALI_CTL_159_DATA */
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+			0x00000000,	/* DENALI_CTL_163_DATA */
+			0x18151100,	/* DENALI_CTL_164_DATA */
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+			0x00000000	/* DENALI_PHY_958_DATA */
+		}
+	},
+};
diff --git a/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-micron-4GB.c b/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-micron-4GB.c
new file mode 100644
index 0000000000..0b00462d6b
--- /dev/null
+++ b/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-micron-4GB.c
@@ -0,0 +1,1566 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ */
+
+#include <soc/sdram.h>
+
+/* 2 MICRON MT52L512M32D2PF chips */
+struct rk3399_sdram_params params = {
+	{
+		{
+			.rank = 0x2,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
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+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x801d181e},
+				{0x17050a08},
+				{0x00000002},
+				{0x00006426},
+				{0x0000004c},
+				0x00000000
+			}
+		},
+		{
+			.rank = 0x2,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
+			.dbw = 0x2,
+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x801d181e},
+				{0x17050a08},
+				{0x00000002},
+				{0x00006426},
+				{0x0000004c},
+				0x00000000
+			}
+		}
+	},
+	.ddr_freq = 800*MHz,
+	.dramtype = LPDDR3,
+	.num_channels = 2,
+	.stride = 13,
+	.odt = 1,
+	{
+		{
+			0x00000700,	/* DENALI_CTL_00_DATA */
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+			0x00000000,	/* DENALI_CTL_03_DATA */
+			0x00000000,	/* DENALI_CTL_04_DATA */
+			0x00000050,	/* DENALI_CTL_05_DATA */
+			0x00027100,	/* DENALI_CTL_06_DATA */
+			0x00000320,	/* DENALI_CTL_07_DATA */
+			0x00001f40,	/* DENALI_CTL_08_DATA */
+			0x00000050,	/* DENALI_CTL_09_DATA */
+			0x00027100,	/* DENALI_CTL_10_DATA */
+			0x00000320,	/* DENALI_CTL_11_DATA */
+			0x00001f40,	/* DENALI_CTL_12_DATA */
+			0x00000050,	/* DENALI_CTL_13_DATA */
+			0x00027100,	/* DENALI_CTL_14_DATA */
+			0x00000320,	/* DENALI_CTL_15_DATA */
+			0x01001f40,	/* DENALI_CTL_16_DATA */
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new file mode 100644
index 0000000000..ac995a82e2
--- /dev/null
+++ b/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-samsung-2GB-24EB.c
@@ -0,0 +1,1565 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
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+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ */
+
+#include <soc/sdram.h>
+
+struct rk3399_sdram_params params = {
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+			0x00000000	/* DENALI_PHY_958_DATA */
+		}
+	},
+};
diff --git a/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-samsung-4GB-04EB.c b/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-samsung-4GB-04EB.c
new file mode 100644
index 0000000000..b4eb49484f
--- /dev/null
+++ b/src/mainboard/google/gru/sdram_params_800/sdram-lpddr3-samsung-4GB-04EB.c
@@ -0,0 +1,1566 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ */
+
+#include <soc/sdram.h>
+
+/* 2 Samsung K4E6E304EB-EGCE chips */
+struct rk3399_sdram_params params = {
+	{
+		{
+			.rank = 0x2,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
+			.dbw = 0x2,
+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x801d181e},
+				{0x17050a08},
+				{0x00000002},
+				{0x00006426},
+				{0x0000004c},
+				0x00000000
+			}
+		},
+		{
+			.rank = 0x2,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
+			.dbw = 0x2,
+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x801d181e},
+				{0x17050a08},
+				{0x00000002},
+				{0x00006426},
+				{0x0000004c},
+				0x00000000
+			}
+		}
+	},
+	.ddr_freq = 800*MHz,
+	.dramtype = LPDDR3,
+	.num_channels = 2,
+	.stride = 13,
+	.odt = 1,
+	{
+		{
+			0x00000700,	/* DENALI_CTL_00_DATA */
+			0x00000000,	/* DENALI_CTL_01_DATA */
+			0x00000000,	/* DENALI_CTL_02_DATA */
+			0x00000000,	/* DENALI_CTL_03_DATA */
+			0x00000000,	/* DENALI_CTL_04_DATA */
+			0x00000050,	/* DENALI_CTL_05_DATA */
+			0x00027100,	/* DENALI_CTL_06_DATA */
+			0x00000320,	/* DENALI_CTL_07_DATA */
+			0x00001f40,	/* DENALI_CTL_08_DATA */
+			0x00000050,	/* DENALI_CTL_09_DATA */
+			0x00027100,	/* DENALI_CTL_10_DATA */
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+			0x00001f40,	/* DENALI_CTL_12_DATA */
+			0x00000050,	/* DENALI_CTL_13_DATA */
+			0x00027100,	/* DENALI_CTL_14_DATA */
+			0x00000320,	/* DENALI_CTL_15_DATA */
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index f14200c804..f14200c804 100644
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+++ b/src/mainboard/google/gru/sdram_params_933/sdram-lpddr3-micron-2GB.c
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index dc7efd9c41..dc7efd9c41 100644
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-micron-4GB.c
+++ b/src/mainboard/google/gru/sdram_params_933/sdram-lpddr3-micron-4GB.c
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index 62c3392dcd..62c3392dcd 100644
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-samsung-2GB-24EB.c
+++ b/src/mainboard/google/gru/sdram_params_933/sdram-lpddr3-samsung-2GB-24EB.c
diff --git a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-samsung-4GB-04EB.c b/src/mainboard/google/gru/sdram_params_933/sdram-lpddr3-samsung-4GB-04EB.c
index 54b7397921..54b7397921 100644
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-samsung-4GB-04EB.c
+++ b/src/mainboard/google/gru/sdram_params_933/sdram-lpddr3-samsung-4GB-04EB.c